首页 > 新闻资讯 Neoverse N1 系统开发平台 (SDP) 是一个基于 N1 CPU 的开发平台，主要用于硬件原型设计、软件开发、系统验证以及性能分析。
Neoverse N1 系统开发平台框图
主要技术参数：
| 开发软件平台 | Armv8.2-A |
| 片上系统兼容架构 | 基于服务器的引导需求；基于服务器的v3系统架构。 |
| 硬件特性 | 双核、双集群 SMP 配置，共有 4 个 N1 CPU。 N1 CPU 2.6GHz 运行速度 缓存（每核）：L1 64kB 指令缓存和数据缓存，1MB 私有 L2 缓存 缓存（共享）：所有内核之间共享2MB L3，8MB共享系统级缓存 (SLC)，两者都可以配置为大小为零 工作频率高达 2GHz 的内部 CMN-600 互连。 GIC-600 和 MMU-600 用于中断管理和 I/O 虚拟化支持。 2个72位DMC-620内存控制器，用于双通道DDR4 2667MHz内存。 两个Cortex-M7 CPU用作系统控制处理器(SCP)和管理控制处理器(MCP)，用于支持事件记录、电源和设备管理。 CoreSight SoC-400 功能调试和跟踪功能。 |
| 板卡扩展支持对应的 外部端口 | 1 个 CCIX Gen4 x16 端口：支持一个支持 x16 CCIX 的适配卡。 1 个 PCIe x16 Gen3 链接到具有下游插槽和外围设备的 48 通道交换机： x16 PCIe Gen3 x8 PCIe Gen3 x1 PCIe Gen3 x1 千兆以太网 x1 SATA III x1 USB 3.0 32位MIPI-60 跟踪端口、JTAG调试端口和Arm CoreSight20 JTAG 连接器仅用于调试。 可选的 PCIe Gen3 转接卡套件，用于通过CCIX连接两个N1 SDP 板，以实现对称多线程 (SMT) 操作 |
| Arm 提供的软件功能 | SCP 固件：系统初始化、冷启动流程、控制时钟和设备管理。 可信固件-A：为 Armv8-A 提供安全世界软件的参考实现，包括在异常级别 3 (EL3) 下执行的安全监视器。 64 位 Linux 驱动程序，包括用于 PCIe、CCIX、SMP 等的驱动程序。 UEFI 和 ACPI 支持。 用于下载包括 Linux 内核在内的开源组件的脚本。 |
| N1 SDP的Linux软件包 | AArch64 Linux内核，支持文件系统和驱动程序，包括用于 PCIe 和 CCIX、芯片到芯片引导和对称多处理的文件系统和驱动程序。 通用可扩展固件接口 (UEFI) 和高级配置和电源接口 (ACPI) 支持。 |
N1 SDP 接口如下图所示
1 系统指示灯
2 BOOT配置拨码开关
3 HDMI 接口
4 PCC以太网接口
5 千兆以太网口和USB3.0口
6 USB3.0口
7 DBG USB口
8 N1 SoC 跟踪口
9 N1 SoC JTAG口接板子上连接器17
10 UART0/1 口
11 接板子上连接器19
N1 SDP 板子如下图所示：
12 插槽 4：PCIe/CCIX ×16 连接器
13 插槽 3：PCIe ×16 连接器
14 插槽 2：PCIe ×16 连接器
15 插槽 1：PCIe ×4 连接器
16 ATX/EPS连接器
17 N1 SoC JTAG口
18 UART0、UART1、UART2 和 UART3
19 连接器10*2
20 RDIMM1 内存
21 RDIMM0 内存
22 ATX 电源连接器和电源指示灯 LED
23 用户开关 SW8
24 用户开关 SW1
25 预留接口
26 IOFPGA micro SD 卡插槽
27 IOFPGA
28 用户LED0
29 用户LED7
30 预留接口
31 IOFPGA JTAG
32 平台控制器芯片 (PCC)
33 7段数码管显示
34 主板配置控制器 (MCC)
35 MCC 配置 micro SD 卡插槽
36 面板连接器
37 PCIe SATA0
38 PCIe SATA1
39 预留按钮
40 硬件复位按钮 PBRESET
41 开/关 及软件复位按钮 PBON
N1 SDP 面板如下图：
42 硬件复位按钮 PBRESET
43 开/关 及软件复位按钮 PBON
44 硬盘活动指示LED，SATA0 和 SATA1 的组合信号
参考：Arm® Neoverse™ N1 System Development Platform Technical Reference Manual
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